MAX6871 データシートの表示（PDF） - Maxim Integrated
部品番号
コンポーネント説明
メーカー
MAX6871 Datasheet PDF : 51 Pages
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EEPROM-Programmable Hex/Quad
Power-Supply Sequencers/Supervisors with ADC
TIMING CHARACTERISTICS
(IN1 = GND, VIN2 = +10V, VIN3 to VIN6 = +2.7V to +5.5V, AUXIN_ = GPI_ = GND, MARGIN = MR = DBP, TA = -40°C to +85°C,
unless otherwise noted. Typical values are at TA = +25°C.) (Notes 1 and 2)
PARAMETER
TIMING CHARACTERISTICS (Figure 2)
Serial Clock Frequency
Clock Low Period
Clock High Period
Bus-Free Time
START Setup Time
START Hold Time
STOP Setup Time
Data-In Setup Time
Data-In Hold Time
SYMBOL
fSCL
tLOW
tHIGH
tBUF
tSU:STA
tHD:STA
tSU:STO
tSU:DAT
tHD:DAT
CONDITIONS
MIN TYP MAX UNITS
400
kHz
1.3
µs
0.6
µs
1.3
µs
0.6
µs
0.6
µs
0.6
µs
100
ns
0
900
ns
Receive SCL/SDA Minimum Rise Time
tR (Note 8)
20 +
0.1 x
ns
CBUS
Receive SCL/SDA Maximum Rise Time
tR (Note 8)
300
ns
Receive SCL/SDA Minimum Fall Time
tF
(Note 8)
20 +
0.1 x
ns
CBUS
Receive SCL/SDA Maximum Fall Time
Transmit SDA Fall Time
tF
(Note 8)
tF
CBUS = 400pF
300
ns
20 +
0.1 x
CBUS
300
ns
Pulse Width of Spike Suppressed
EEPROM Byte Write Cycle Time
tSP (Note 9)
tWR (Note 10)
50
ns
11
ms
Note 1: Specifications guaranteed for the stated global conditions. The device also meets the parameters specified when 0 < VIN1
< +6.5V, and at least one of VIN3 through VIN6 is between +2.7V and +5.5V, while the remaining VIN3 through VIN6 are
between 0 and +5.5V.
Note 2: Device may be supplied from any one of IN_, except IN2.
Note 3: The internal supply voltage, measured at ABP, equals the maximum of IN3 to IN6 if VIN1 = 0, or equals +5.4V if VIN1 >
+6.5V. For +4V < VIN1 < +6.5V and VIN3 through VIN6 > +2.7V, the input that powers the device cannot be determined.
Note 4: 100% production tested at TA = +25°C and TA = +125°C. Specifications at TA = -40°C are guaranteed by design.
Note 5: VIN_ > 0.3 x ADC range.
Note 6: Does not include the inaccuracy of the external +1.25V voltage reference.
Note 7: DNL implicitly guaranteed by design in a sigma-delta converter.
Note 8: CBUS = total capacitance of one bus line in pF. Rise and fall times are measured between 0.1 x VBUS and 0.9 x VBUS.
Note 9: Input filters on SDA, SCL, A0, and A1 suppress noise spikes < 50ns.
Note 10: An additional cycle is required when writing to configuration memory for the first time.
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